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VHDL-Simulation und -Synthese
Entwurf digitaler Schaltungen und Systeme
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- 565 Seiten
- German
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VHDL-Simulation und -Synthese
Entwurf digitaler Schaltungen und Systeme
Angaben zum Buch
Inhaltsverzeichnis
Quellenangaben
Über dieses Buch
Die erweiterte 8. Auflage dieses Standardwerks ergänzt die bisherige Darstellung der VHDL-Simulation des Buches durch konkrete Benutzeranleitungen für den VHDL-Simulator ModelSim. Auch wird die Verwendung des Simulations- und Synthesewerkzeugs Vivado vorgestellt, erforderlich um VHDL-Code in neueren FPGAs der Fa. Xilinx zu implementieren. Mit ausgewählten Beispielen werden Implementierungen für Artix-FPGAs vorgestellt und diskutiert.
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Information
Inhaltsverzeichnis
- Vorwort
- Inhaltsverzeichnis
- 1. Einleitung und Übersicht
- 2. VHDL-Entwurf einfacher Schaltnetze
- 3. Entwurf digitaler Funktionselemente mit Prozessen
- 4. Tri-State- und Don’t-Care-Modellierung
- 5. Arithmetik und Synchronzähler
- 6. FPGA-Synthese und Implementierung synchroner Schaltungen
- 7. Entwurf von Zustandsautomaten
- 8. Struktureller VHDL-Entwurf
- 9. Entwurf eines RISC-Prozessors
- 10. Modellierung digitaler Filter
- 11. Zustandsdifferenzengleichungen für Beobachter
- 12. Erweiterungen durch den Standard VHDL-2008
- 13. Anhang
- 14. Literaturverzeichnis
- 15. Sachregister